KU_TECH

특허명	프로그램 가능한 주파수 분주기 및 분주 방법
출원인	고려대학교 산학협력단	출원일	2008년 9월 2일
공개일	2010년 3월 11일	공고일	2010년 8월 11일
요약	본 발명은 프로그램 가능한 주파수 분주기(Programmable Frequency Divider: PD)에 관한 것으로, 보다 상세하게는 매우 높은 주파수를 발생시키는 위상 고정 루프(Phase Locked Loop, PLL)를 이용한 주파수 합성기(Frequency Synthesizer)의 핵심 모듈인 프로그램 가능한 주파수 분주기에 관한 것이다. 본 명세서에서 개시하는 프로그램 가능한 주파수 분주기는 분주비 제어신호(MC 신호)에 의해 입력 클럭(F in )의 주파수를 제1 분주비(N+1) 또는 제2 분주비(N)로 분주한 분주 클럭(D out )을 생성하는 분주 클럭 생성부; 상기 D out 의 개수(CNT)를 카운팅하되, 상기 CNT의 스왈로우 모드 카운팅과 상기 CNT의 프로그램 모드 카운팅을 직렬적으로 수행하는 카운팅부; 및 상기 CNT와 상기 스왈로우 모드 카운팅의 수(S)와 상기 CNT의 최대의 수에 해당하는 상기 프로그램 모드 카운팅의 수(P)를 이용하여 상기 MC 신호를 생성하여 상기 분주 클럭 생성부에 피드-백(feedback)하고, 상기 카운팅부의 리셋 제어신호(RST 신호)를 생성하는 제어신호 생성부를 포함한다.

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