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대기전류를 절감하는 디지털 LDO 레귤레이터
| 특허명 | 대기전류를 절감하는 디지털 LDO 레귤레이터 | ||
| 출원인 | 고려대학교 산학협력단 | 출원일 | 2018년 4월 2일 |
| 공개일 | None | 공고일 | 2019년 10월 4일 |
| 요약 |
본 발명에 따른 디지털 LDO(low drop-out) 레귤레이터는 입력 전압을 조절하여 출력 전압을 출력하는 패스 트랜지스터 어레이, 기준 전압 및 상기 출력 전압의 차이에 기초하여 상기 패스 트랜지스터 어레이를 제어하는 제어 비트를 생성하며, 외부로부터 수신된 클록으로부터 생성된 제1 클록에 기초하여 동작 여부가 결정되는 제어 로직, 그리고 상기 외부로부터 수신된 클록의 사용 없이 상기 출력 전압의 전압 변동을 감지하고, 상기 전압 변동이 발생하는 경우 상기 제어 로직이 상기 전압 변동에 대응하여 상기 출력 전압을 회복시키도록 상기 제1 클록보다 주파수가 높은 제2 클록을 상기 전압 변동을 이용하여 생성하는 자체 클록 버스트 로직을 포함하되, 상기 제어 로직은 상기 전압 변동이 발생하는 경우 상기 제2 클록에 기초하여 상기 제어 비트를 생성한다.
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